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IP核

 

Xilinx IP 核是 Xilinx 目标设计平台内的一个重要组成部分,包括大量基础级内核以满足 FPGA 设计者的一般需求,以及强大的区域和市场专用内核以满足 DSP、嵌入式和连接功能设计的特殊需求。Xilinx IP 可以实现标准功能的资源密集型开发,能帮助 FPGA 设计者集中精力实现差异化。

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*12.1是 Virtex-6 和 Spartan-6 设计必需的更新。必须重新生成本页面所列之内核版本方可整合主要的增强功能。